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논문 기본 정보

자료유형
학술저널
저자정보
한시연 (Dong-A University) 정세민 (Dong-A University) 강봉순 (Dong-A University)
저널정보
한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제27권 제4호
발행연도
2023.12
수록면
127 - 133 (7page)

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영상처리는 현재 다양한 분야에서 활용되고 있다. 그중 자율주행 자동차, 의료 영상처리, 로봇 제어 등은 빠른 영상처리 응답 속도가 필요하다. 이를 충족하기 위해 실시간 처리를 위한 하드웨어 설계가 활발히 연구되고 있다. 하드웨어 처리 속도는 입력 영상의 크기 외에도, 이미지에서 라인과 프레임을 구분하는 비활성화 영상 공백 구간의 크기에 영향을 받는다. 본 논문에서는 비활성화 영상 공백 구간과 밀접한 관련이 있는 라인메모리 유형에 따라 세 가지 스케일러 구조를 설계한다. 이 구조들은 Verilog 표준 언어를 사용하여 하드웨어로 설계되고, Xilinx Vivado 2023.1을 이용하여 field programmable gate array 환경에서 논리회로로 합성된다. 합성된 결과는 실시간 처리할 수 있는 표준 이미지 크기를 비교하면서 프레임 레이트 분석에 사용된다.
#Verilog #Xilinx #Real-time processing #Interpolation #Dual-port RAM #Single-port RAM

목차

Abstract
요약
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 프레임 레이트 분석 결과
Ⅳ. 결론
References

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