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박재현 (한양대학교) 김병호 (한양대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2021년도 대한전자공학회 추계학술대회 논문집
발행연도
2021.11
수록면
52 - 55 (4page)

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Flash analog-to-digital converters (ADCs) suffer significantly from their offset voltage variation in sub-micron process technology, thereby lower linearity performance. This paper proposes an efficient flash ADC design method to calibrate the linearity error of flash ADC by wiggling comparators’ offset based on histograms. Comparators with variable offset are employed, and their linearity errors can be analyzed and corrected (i.e., calibrated) based on the relationship between the integral nonlinearity (INL) and the ADC decision levels. The behavioral simulation results using an 8-bit ADC showed the DNL and the INL improved by 0.51 LSB and 1.86 LSB, respectively.

목차

Abstract
Ⅰ. 서론
Ⅱ. Error detection method
Ⅲ. Proposed calibration algorithm
Ⅳ. Simulation result
Ⅴ. 결론 및 향후 연구 방향
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