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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.21 No.1
- 발행연도
- 2021.2
- 수록면
- 49 - 61 (13page)
- DOI
- 10.5573/JSTS.2021.21.1.049
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Owing to the recognition of the field-programmable gate array (FPGA) as a key component of Internet of Things (IoT) devices, there has been exponential growth in the demand for FPGAs. Along with this increased demand, FPGA security issues have also drawn significant attention. An attacker can extract bitstream, the configuration data stored in FPGAs, and manipulate it to insert a malicious circuit (e.g., Trojan attack). To prevent such attacks, it is essential to identify their root cause and implement countermeasures. In this study, we target Xilinx FPGAs, which provides two FPGA design software, Integrated Software Environment (ISE) design suite and Vivado design suite, depending on the FPGA family. While FPGA reverse engineering has been studied extensively using ISE, little work has been done on Vivado environment. No research has been conducted on the reverse engineering of programmable interconnect points (PIPs), which is essential for reverse engineering of complete circuit. In this study, we propose an FPGA reverse engineering method using the latest Vivado design suite environment FPGAs to extract complete circuits by combining both logic data from programmable logic points and signal connectivity data from PIPs extracted from the bitstream. We performed reverse engineering of 3-bit adder circuit targeting an ARTIX-7 family chip, using Verilog and Vivado design suite. It was confirmed that the logic recovered from bitstream is identical to the actual 3-bit adder circuit, verifying 100% recovery rate of the proposed reverse engineering method.
목차
Abstract
I. INTRODUCTION
II. BACKGROUND
III. REVERSE ENGINEERING OF XILINX 7-SERIES FPGA
IV. EXPERIMENTS
V. CONCLUSIONS
REFERENCES
참고문헌 (22)
참고문헌 신청
Virtex-5 FPGA Configuration User Guide UG071, https://www.xilinx.com/
A. Moradi, et al., “On the vulnerability of FPGA bitstream encryption against power analysis attacks,” in Proc. of the Conf. on Computer and Communications Security, pp. 111-124, Oct, 2011.
H. Yu, H. Lee, S. Lee, Y. Kim, H. M. Lee, “Recent Advances in FPGA Reverse Engineering,” Electronics, 7.10, 246, 2018.
A. Facon, S. Guilley, X. T. Ngo, T. Perianin, “Hardware-enabled AI for Embedded Security: A New Paradigm,” in Proc. of the 3rd International Conference on Recent Advances in Signal Processing, Telecommunications & Computing (SigTelCom 2019), pp. 80-84, Mar., 2019.
S. Malhotra, T. Borer, D. Singh, S. Brown, “The Quartus University Interface Program: Enabling advanced FPGA research,” in Proc. of the IEEE International Conference on Field-Programmable Technology, pp. 225-230, Dec., 2004.
A. Moradi, et al., “On the vulnerability of FPGA bitstream encryption against power analysis attacks,” in Proc. of the Conf. on Computer and Communications Security, pp. 111-124, Oct, 2011.
H. Yu, H. Lee, S. Lee, Y. Kim, H. M. Lee, “Recent Advances in FPGA Reverse Engineering,” Electronics, 7.10, 246, 2018.
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