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논문 기본 정보

자료유형
학술저널
저자정보
Jongsu Park (Samsung Electronics)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제23권 제12호
발행연도
2019.12
수록면
1,734 - 1,737 (4page)

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This paper presents a prediction structure with a Hybrid Dynamic Branch Prediction (HDBP) scheme which decreases the number of stalls. In the application, a branch history register is dynamically adjusted to produce more unique index values of pattern history table (PHT). The number of stalls is also reduced by using the modified gshare predictor with a long history register folding scheme. The aliasing rate decreased to 44.1% and the miss prediction rate decreased to 19.06% on average compared with the gshare branch predictor, one of the most popular two-level branch predictors. Moreover, Compared with the gshare, an average improvement of 1.28% instructions per cycle (IPC) was achieved. Thus, with regard to the accuracy of branch prediction, the HDBP is remarkably useful in boosting the overall performance of the superscalar processor.

목차

ABSTRACT
Ⅰ. Introduction
Ⅱ. Proposed Architecture
Ⅲ. Measurement Results
Ⅳ. Conclusion
REFERENCES

참고문헌 (8)

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