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저자정보
Le Dinh Trang Dang (Kyunghee University) Nguyen Thi My Kieu (Kyunghee University) Ik Joon Chang (Kyunghee University) Jinsang Kim (Kyunghee University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.16 No.5
발행연도
2016.10
수록면
605 - 614 (10page)

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We develop a novel SAD circuit for power-efficient H.264 encoding, namely a-SAD. Here, some highest-order MSB’s are approximated to single MSB. Our theoretical estimations show that our proposed design simultaneously improves performance and power of SAD circuit, achieving good power efficiency. We decide that the optimal number of approximated MSB’s is four under 8-bit YUV-420 format, the largest number not to affect video quality and compression-rate in our video experiments. In logic simulations, our a-SAD circuit shows at least 9.3% smaller critical-path delay compared to existing SAD circuits. We compare power dissipation under iso-throughput scenario, where our a-SAD circuit obtains at least 11.6% power saving compared to other designs. We perform same simulations under two-and three-stage pipelined architecture. Here, our a-SAD circuit delivers significant performance (by 13%) and power (by 17% and 15.8% for two and three stages respectively) improvements.

목차

Abstract
I. INTRODUCTION
II. THEORETICAL COMPARISONS OF EXISTING SAD CIRCUITS
III. APPROXIMATE-SAD CIRCUIT DESIGN
IV. SIMULATION RESULTS
V. CONCLUSION
REFERENCES

참고문헌 (16)

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