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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2015.6
- 수록면
- 282 - 285 (4page)
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This paper proposes a low-dropout voltage legulator(LDO) for mobile applications. The proposed LDO has fast transient response for a load step by using dynamic current-biasing and channel splitting compensatation. For a 1.4~1.8 V input voltage and 1.3 V output voltage, the simulated undershoot and overshoot is only 13mV and 77mV, respectively, for load transient of 10uA to 10mA within edge times of 100 ns. The proposed LDO dissipates 70uA at no-load condition. The circuit was designed by a 0.18㎛ CMOS technology.
목차
Abstract
Ⅰ. 서론
Ⅱ. 제안하는 LDO설계
Ⅲ. 시뮬레이션
Ⅳ. 결론
참고문헌
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