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논문 기본 정보

자료유형
학위논문
저자정보

조형준 (성균관대학교, 성균관대학교 일반대학원)

지도교수
김병성
발행연도
2014
저작권
성균관대학교 논문은 저작권에 의해 보호받습니다.

이용수4

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이 논문의 연구 히스토리 (2)

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본 논문에서는 20GHz Integer-N PLL(Phase Locked Loop)과 QILO(Quadra-
ture Injection Locked Oscillator)를 이용하여 무선 홈 네트워크용 60GHz Quadrature 주파수 합성기를 설계하였다.
60 GHz Quadrature 주파수 합성기는 65 nm CMOS 공정을 이용하여 제작되었으며 60GHz 출력의 위상잡음을 향상시키고 Quadrature 신호를 얻기 위해 20GHz 신호를 60GHz QILO에 주입하는 기법을 사용하였다.
60GHz 주파수 대역에서 4개의 채널 주파수를 생성해야 하므로 20GHz Integer-N PLL이 432, 448, 464, 480의 분주비를 가지도록 설계하였으며 기준주파수로 45MHz를 사용하였다.
20GHz VCO를 free running으로 동작하였을 경우 위상잡음 특성은 중심주파수로부터 1MHz 오프셋에서 -69.01dBc/Hz 이고 Integer-N PLL로 동작하였을 경우 위상잡음 특성은 1MHz 오프셋에서 -86.58dBc/Hz이다.
20GHz Integer-N PLL은 18.9GHz에서 20.4GHz까지 주파수 조절이 가능하며 주파수 조절 가능 범위 내에서 최소 -32dBm의 출력을 나타낸다. 60GHz QILO는 63.9GHz 에서 67.9GHz까지 주파수 조절이 가능하며 주파수 조절가능 범위 내에서 최소 -67dBm의 출력을 나타낸다.

목차

제1장 서론 . 3
제2장 60GHz 주파수 대역 무선 통신 4
제1절 60GHz 무선 홈 네트워크. 4
제2절 주파수 합성기 구조 . 5
제3장 60 GHz Quadrature Output 주파수 합성기 . 7
제1절 전압 제어 발진기(Voltage-controlled oscillator, VCO) 9
제2절 주입 잠금 발진기(Injection-locked Oscillator) 12
제3절 CML 주파수 분주기(Current mode logic frequency divider) 14
제4절 TSPC 주파수 분주기(True single phase clocking frequency divider). 17
제5절 멀티 모듈러스 분주기(Multi-modulus divider, MMD) . 20
제6절 위상 주파수 검출기(Phase frequency detector, PFD) 24
제7절 전하 펌프(Charge pump, CP) 29
제8절 루프 필터(Loop filter, LF) 32
제9절 측정결과 35
제4장 결론 42
참고 문헌. 45
Abstract . 49

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