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저자정보
Minhyuk Kim (한국해양대학교) Jongtae Bae (한국해양대학교) Suksoon Choi (한국해양대학교) Taedoo Park (한국해양대학교) Namsoo Kim (한국해양대학교) Jiwon Jung (한국해양대학교)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2008
발행연도
2008.7
수록면
1,673 - 1,676 (4page)

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This paper describes the design methodology of serial concatenate of extended RS code, trellis coded modulation with 64-/256-QAM, based upon testing and characterization of cable systems.
In implementing the cable modem, there are some problems to fabricate and fitting on FPGA chip. First, many clocks are needed in implementing cable modem because of different code rate and different modulation types. To reduce the number of clocks, we use the two memories, which are different clock speed for reading and writing data. Second, this system lost the bit-synchronization and framesynchronization in decoder, the system recognizes that all data is error. This paper solves the problems by using simple 5-stage registers and unique sync-word.
Based on solutions for about problems, the cable modem is fabricated on FPGA chip name as Vertex Ⅱ pro xc2vp30-5 by Xilinx, and we confirmed the effectiveness of the results.

목차

Abstract
1. Introduction
2. FEC for CATV Down Stream
3. Result of Simulation
4. Problems and Solutions of Implementation
5. Implementation
6. Conclusion
References

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