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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2008
- 발행연도
- 2008.7
- 수록면
- 365 - 368 (4page)
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In this paper, hardware called a hardware task engine is proposed to achieve embedded controller architecture for signal processing. An interrupt task that is highest priority and executes a signal processing is executed a hardware task engine. A hardware task engine works highly realtime, because of it has high-speed and flexible processing ability, and it reduces start up delay from interrupt signal. A prototype of a hardware task engine is made FPGA, and is evaluated on actual magnetic encoder. Start up delay from interrupt signal of a hardware task is 41.60 nanoseconds, and it is faster than software by 3.0 times at a half clock frequency, and temperature rise is reduced to 13.4%. As a result, we can corroborate availability of a hardware task engine.
목차
Absract
1. Introduction
2. A magnetic encoder
3. A hardware task engine
4. Evaluation result
5. Conclusion
References
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