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이용수
ABSTRACT
1. INTRODUCTION
2. CIRCUIT IMPLEMENTATION
3. MEASUREMENT
4. REFERENCES
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PLL을 이용한 750Mhz ~ 1.1Ghz Clock Generator ( A PLL-based Clock Generator with 750Mhz ~ 1.1Ghz Lock Range )
한국통신학회 학술대회논문집
1998 .01
A 3.125-Gb/s Optical Transceiver in 0.18㎛ CMOS
대한전자공학회 워크샵
2008 .09
Design of 2.5Gb/s non-PLL-type All-Digital Clock Recovery Circuit
대한전자공학회 ISOCC
2010 .11
A Low Power 6.4 Gb/s Serial Link Transmitter in 0.18㎛ CMOS Technology
대한전자공학회 워크샵
2008 .09
CMOS 공정을 이용한 3.12GHz PLL 설계
대한전자공학회 학술대회
2005 .05
주파수 동기를 위한 저 잡음 2.5V 300㎒ CMOS PLL
대한전자공학회 학술대회
2003 .07
Low jitter 1.5㎓ spread spectrum clock generator
대한전자공학회 ISOCC
2012 .11
A CMOS 3.2 Gb/s 4-PAM serial link transceiver
대한전자공학회 ISOCC
2009 .11
Low Jitter PLL using Self-Biasing Technique
대한전자공학회 ISOCC
2004 .10
PLL을 이용한 750Mhz ~ l.lGhz Clock Generator
한국통신학회 학술대회논문집
1998 .07
A 0.12GHz-1.4GHz DLL-based clock generator with a multiplied 4-phase clock using a 0.18um CMOS Process
대한전자공학회 ISOCC
2006 .10
A 3.1 to 5 GHz CMOS Transceiver for DS-UWB Systems
[ETRI] ETRI Journal
2007 .08
HDMI 송ㆍ수신단을 위한 클록 발생기 설계
대한전자공학회 학술대회
2009 .07
PLL 방식 10Gb/s 클럭추출 및 데이터 재생회로
대한전자공학회 학술대회
1996 .11
PLL방식 10 Gb/s 클럭추출 및 데이터 재생회로 ( 10 Gb/s Clock Extraction and Data Regeneration Circuit Implemented with a PLL )
대한전자공학회 학술대회
1996 .11
Computer Simulation of Jitter Characteristics of PLL for Arbitrary Data and Jitter Patterns
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1993 .01
PLL을 이용한 클럭발생기의 설계 ( A Design of a PLL-based Clock Generator )
대한전자공학회 학술대회
1997 .11
PLL을 이용한 클럭발생기의 설계
대한전자공학회 학술대회
1997 .11
LC형 다중 위상 PLL 이용한 40Gb/s 0.18㎛ CMOS 클록 및 데이터 복원 회로
전자공학회논문지-SD
2008 .04
Design of Offset Self-Biased PLL for Low Jitter
대한전자공학회 ISOCC
2005 .10
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