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논문 기본 정보
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- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 1,458 - 1,461 (4page)
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To design an integrated 6-bit flash ADC and DSP circuit on SoC using double-base number system (DBNS), this paper proposes new model with partition technique to design the conversion of double-base number to floating-point number unlike other approaches which need ROM architecture. The basic idea of partition technique is to find on the linear approximation of function power of 2 in range of [0, 1). A FIR filter is designed to prove the effectiveness of the new proposed algorithm. The simulation results reveal the proposed design is more attractive than the previous researches in DBNS applications.
목차
Abstract
1. Introduction
2. DBNS FIR filter and converting derivation
3. Ternary Conversion Architecture
4. Simulation and results
5. Conclusion
References
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