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논문 기본 정보
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- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 1,192 - 1,195 (4page)
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MPSoC (Multi-Processor System-on-Chip) designs are widely adopted in embedded system designs. As more components are integrated into a single chip, conventional shared bus communication architectures no longer meet the performance requirement. In this paper, we propose a novel hybrid bus topology which is capable of selectively providing both shared bus communications and crossbar switch accesses. This topology is very effective in providing ample bandwidth for memory accesses which is often a performance bottleneck in MPSoC designs. We designed the proposed bus architecture and performance evaluation shows that our proposed bus provides much improved bandwidths with little area and power overheads compared with conventional shared bus interconnection structures.
목차
Abstract
1. Introduction
2. Motivation for a new bus topology
3. The proposed hybrid bus topology
4. Performance Evaluation
5. Conclusion
ACKNOWLEDGMENT
References
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