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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2010.5
- 수록면
- 31 - 40 (10page)
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본 논문에서는 IEEE 802.11n 무선 랜 표준용 LDPC 복호기 프로세서를 설계하였다. 설계된 프로세서는 IEEE 802.11n 표준의 블록길이 1,944와 부호화율 1/2의 패리티 검사 행렬을 지원하며, 하드웨어 감소를 위해 최소합 알고리듬과 layered 구조를 적용하였다. 최소합 알고리듬의 특징을 이용한 검사노드 메모리 최소화 방법을 고안하여 적용하였으며, 이를 통해 기존방법의 메모리 크기의 25%만을 사용하여 구현하였다. 설계된 프로세서를 0.35-㎛ CMOS 셀 라이브러리로 합성한 결과, 200,400 게이트와 19,400 비트의 메모리로 구현되었으며, 80 ㎒@2.5V로 동작하여 약 135 Mbps의 성능을 갖는다. 설계된 회로는 FPGA 구현을 통해 하드웨어 동작 검증과 복호성능을 분석하였으며, 이를 통해 설계된 LDPC 복호기의 유용성을 입증하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. LDPC 복호 알고리듬
Ⅲ. IEEE 802.11n용 LDPC 복호기 설계
Ⅳ. 설계검증 및 성능평가
Ⅴ. 결론
감사의 글
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1. [학술지(정기간행물)] - R. Gallager / 1962 / Low-Density Parity-Check Codes / IRE Trans. Info. Theory 8 : 21 ~ 28
2. [학술지(정기간행물)] - D.Mackay / 1962 / Near Shannon Limit Performance of Low Density Parity Check Codes / Electro.Lett 32 (6) : 1645 ~ 1646
3. [학술지(정기간행물)] - T.Rhicardson / 2001 / Efficient Encoding of Low Density Parity-Check Codes / IEEE Trans.Inform.Theory 47 : 638 ~ 656
4. [기타자료] - J.W.Bond / 2000 / Constructing low-density parity-check codes / EUROCOMM 2000. Information System for Enhanced Public Safety and Security : 260 ~ 262
5. [기타자료] - / 2004 / DVB-S2 Draft ETSI EN 302 307 V1.1.1 (2004-06) / ETSI
2. [학술지(정기간행물)] - D.Mackay / 1962 / Near Shannon Limit Performance of Low Density Parity Check Codes / Electro.Lett 32 (6) : 1645 ~ 1646
3. [학술지(정기간행물)] - T.Rhicardson / 2001 / Efficient Encoding of Low Density Parity-Check Codes / IEEE Trans.Inform.Theory 47 : 638 ~ 656
4. [기타자료] - J.W.Bond / 2000 / Constructing low-density parity-check codes / EUROCOMM 2000. Information System for Enhanced Public Safety and Security : 260 ~ 262
5. [기타자료] - / 2004 / DVB-S2 Draft ETSI EN 302 307 V1.1.1 (2004-06) / ETSI
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