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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2011.6
- 수록면
- 350 - 353 (4page)
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This paper describes a design of LDPC decoder for block length 576-bits and code rate 1/2 of IEEE 802.16e mobile WiMAX standard. The designed LDPC decoder employs the min-sum algorithm and partially parallel layered-decoding architecture which processes a sub-block of 24×24 in parallel. By exploiting the properties of min-sum algorithm, a new memory reduction technique is proposed, which reduces check node memory by 46% compared to conventional method. Our LDPC decoder synthesized with a 0.18-㎛ CMOS cell library has 88,210 gates and 13,248 bits memory, and the estimated throughput is about 53 Mbps at 58-MHz@1.8-V.
목차
Abstract
Ⅰ. 서론
Ⅱ. LDPC 부호 및 복호 알고리듬
Ⅲ. WiMAX용 LDPC 복호기 설계
Ⅳ. 레이아웃 설계 및 검증
Ⅴ. 결론
참고문헌
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