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저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2009년 SoC학술대회
발행연도
2009.5
수록면
107 - 110 (4page)

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본 논문에서는 빠른 연산처리를 위해 공통 연산기와 공통 레지스터를 사용한 H.264 용 고속 인트라 예측 회로구조를 제안한다. 제안하는 인트라 예측 회로구조는 복잡한 메모리 접근으로 인한 전력손실을 방지하기 위해 외부 및 내부 메모리를 효율적으로 사용하였으며, 4-입력 예측 연산기와 2-입력 예측 연산기를 사용하여 빠르고 효율적인 연산처리를 한다. 또한 재사용율이 높은 공통 레지스터를 사용하여 불필요한 연산처리가 이루어지지 않도록 하였다. 제안하는 인트라 예측 회로는 130㎚ 표준 셀 공정을 사용하여 최대 101㎒의 동작주파수에서 HD급(1920×1088) 영상을 초당 60장까지 처리할 수 있다.
#인트라 예측 #H.264 #디코더 #회로 구조

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 고성능 인트라 예측 회로 구조
Ⅲ. 실험결과
Ⅳ. 결론
Acknowledgements
참고문헌

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조량석 ,  원치선 대한전자공학회 학술대회 2003 .07

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