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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第45卷 第6號
발행연도
2008.6
수록면
60 - 67 (8page)

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이 논문의 연구 히스토리 (2)

2008

2.4㎓ ISM 대역 응용을 위한 저전력 CMOS Fractional-N 주파수합성기 설계
오근창 ,  김경환 ,  박종태 외 1명 전자공학회논문지-SD 2008.06 학술저널

2007

2.4GHz 대역 CMOS Fractional-N 주파수합성기 설계
오근창 ,  차충현 ,  박종태 외 1명 대한전자공학회 학술대회 2007.05 학술대회자료

초록· 키워드

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본 논문에서는 Bluetooth, Zigbee, WLAN 등 2.4㎓ 대역 ISM-band 응용 분야를 위한 저 전력 주파수 합성기를 설계하였다. 저 전력 특성을 얻기 위해 전류소모가 큰 VCO, prescaler, Σ-Δ modulator 등의 전력소모를 최적화하는데 중점을 두고 설계하였다. VCO는 전력소모 측면에서 유리한 NP-core 유형의 구조를 선택하여 위상잡음 특성과 전력소모를 최적화하였으며, prescaler는 정적 전류소모가 거의 없는 동적 회로 기술이 적용된 D-F/F을 사용하여 전력소모를 줄였다. 또한 다수의 로직으로 구성되는 3차 Σ-Δ modulator는 ‘mapping circuit’으로 구조를 단순화하여 작은 면적과 저 전력소모 특성을 갖도록 하였다. 0.18㎛ CMOS 공정으로 IC를 제작하여 성능을 측정한 결과 설계된 주파수 합성기는 1.8V 전원전압에서 7.9㎃의 전류를 소모하고, 100㎑ offset에서 -96㏈c/㎐, 1㎒ offset에서 -118㏈c/㎐의 위상 잡음 특성을 보였다. 또한 spur 잡음 특성은 -70㏈c이며, 25㎒ step의 주파수 변화에 따른 위상 고정 시간은 약 15㎲이다. 설계된 회로의 칩 면적은 pad를 포함하여 1.16㎟이며 pad를 제외한 면적은 0.64㎟이다.
#Fractional-N Frequency Synthesizer #PLL #Low-power #VCO #CMOS

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 회로 설계
Ⅲ. 측정 결과
Ⅳ. 결론
참고문헌
저자소개

참고문헌 (12)

참고문헌 신청
B.Razavi , 1998 , RF Microelectronics , Prentice Hall PTR google schola D. Theil , 2001 , A fully integrated CMOS frequency synthesizer for Bluetooth , Proc. IEEE RFIC Symposium : 103 ~ 106 google schola J. W. M. Rogers , 2006 , Design and characterization of a 5.2GHz, 2.4GHz Σ-Δ fractional-N frequency synthesizer for low-phase noise performance , EURASIP Jour. Wireless Communications and Networking 2006 : 1 ~ 11 google schola C. L. Ti , 2007 , A 2.4-GHz 18-mW Two-Point Delta-Sigma Modulation Transmitter for IEEE 802.15.4 , IEEE VLSI-DAT : 188 ~ 191 google schola S. Pamarti , 2004 , A Wideband 2.4-GHz Delta-Sigma Fractional-N PLL with 1-Mb, s In-Loop Modulation , IEEE JSSC 39 (1) : 49 ~ 62 google schola

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