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한국전자파학회 한국전자파학회논문지 韓國電磁波學會論文誌 第17卷 第8號(특집호)
발행연도
2006.8
수록면
732 - 738 (7page)

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10 ㎓까지 동작하는 주파수 1/2 분배기와 주파수 1/4 분배기를 설계하였다. 회로에 사용된 설계 방법은 단일위상 분주 방식이다. 단일 위상 분주 방식 분배기는 단 하나의 클럭 신호만을 필요로 하고 회로를 구성하는 소자도 크기가 작은 능동 소자로 이루어져 구조가 매우 간단한 장점이 있다. 측정을 통하여 바이어스 전압이 높아질수록 free running 주파수와 동작 주파수 영역이 높아짐을 확인할 수 있었다. 주파수 1/2 분배기와 주파수 1/4 분배기 회로에 바이어스 전압 3.0~4.0 V, 입력 파워 16 ㏈m, 오프셋 전압 1.5~2.0 V, 10 ㎓ 입력 신호를 가했을 때 입력 주파수의 1/2, 1/4에 해당하는 5 ㎓, 2.5 ㎓의 출력 신호를 각각 얻을 수 있었다. 주파수 1/2 분배기의 레이아웃 크기는 500×500 u㎡이고 측정용 패드와 연결 부분을 제외한 순수한 레이아웃 크기는 50×40 u㎡이다.
#Microwave PLL #TSPC #Divide-by-2 #Free Running Frequency #Input Sensitivity

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
참고문헌
저자소개

참고문헌 (9)

참고문헌 신청
, 2004 , A 13.5 mW 5 GHz frequency synthesizer with dynamic logic frequency divider 39 (2) : 378 ~ 383 google schola , 1989 , High-speed CMOS circuit technique 24 : 62 ~ 70 google schola , 1996 , Speed optimization of edge-triggered CMOS circuits for gigahertz single- phase clocks 31 (3) : 456 ~ 465 google schola , 2005 , A microwave frequency divider using an inverter ring and transmission gates 15 : 330 ~ 332 google schola , 2005 , High frequency divider using inverters and transmission gates google schola

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