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대한전자공학회 전자공학회논문지-SP 전자공학회논문지 SP편 제43권 제1호
발행연도
2006.1
수록면
101 - 109 (8page)

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이 논문에서는 64-Point FFT Radix-4 알고리즘을 DA(Distributed Arithmetic)연산을 이용하여 효율적으로 나비연산 구조를 설계할 수 있음을 보였다. 기존의 convolution 연산에 사용되어 왔던 DA연산이 FFT 나비연산의 트위들 계산에도 효과적으로 사용될 수 있음을 보였다. 제안된 DA 나비연산 구조를 Verilog HDL 코딩으로 구현한 결과, 기존의 승산기를 사용한 나비연산 구조와 비교하여 61.02%의 cell area 감소 효과를 보였다. 또한 제안된 나비연산 구조를 파이프라인 구조에 적용하여 지연변환기와 함께 사용한 전체 64-point Radix-4 FFT 구조의 Verilog-HDL 코딩을 기존의 승산기를 사용한 구조의 코딩과 비교한 결과, 46.1%의 cell area 감소효과를 볼 수 있었다. 따라서 제안된 FFT 구조는 DMB용 OFDM 모뎀과 같은 큰 크기의 FFT에 효율적으로 사용될 수 있는 구조가 될 것이다.

목차

요 약

Abstract

Ⅰ. 서 론

Ⅱ. Radix-4 FFT 알고리즘과 Distributed Arithmetic 연산

Ⅲ. 제안된 Radix-4 FFT용 나비연산 구조

Ⅳ. 실험 및 고찰

Ⅴ. 결 론

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