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이용수
요약
1. 소개
2. 반복적인 알고리즘을 위한 시스톨릭 설계
3. 상당히 큰 크기의 Matrix들을 위한 Multiplication
4. 비동기 설계와 시간 분석
5. 결론
참고 문헌
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행렬곱을 위한 시스톨릭 어레이 아키텍춰의 설계 ( A Design of Systolic Array Architecture for Matrix Multiplication )
대한전자공학회 학술대회
1991 .11
행렬곱을 위한 비동기 어레이 아키텍춰의 설계 ( A Design of Asynchronous Array Architecture for Matrix Multiplication )
대한전자공학회 학술대회
1991 .11
Low-area Bit-parallel Systolic Array for Multiplication and Square over Finite Fields
한국컴퓨터정보학회논문지
2020 .02
A Systolic Array Architecture for a Modular Multiplication Algorithm
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1995 .01
Fixed-size Systolic Arrays for the Modular Multiplication
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1997 .01
모듈러 곱셈을 위한 선형 시스톨릭 어레이 설계 및 분석
정보과학회논문지(A)
1997 .11
몽고메리 알고리즘을 위한 고정-크기 시스톨릭 어레이 설계 및 분석
정보과학회논문지(A)
1999 .04
효율적인 Radix-4 모듈러 곱셈기의 시스톨릭 어레이 구조
대한전자공학회 학술대회
2002 .11
비트 수준 슈퍼 시스톨릭 어레이의 설계
전자공학회논문지-SD
2005 .12
디지털 신호처리를 위한 비동기 제어 시스톨릭 설계 ( Systolic Design with Asynchronous Controls for Digital - Signal Processings )
한국통신학회논문지
1993 .03
FPGA Based Systolic Array for Modular Multiplication Using Precomputed Addition Value
한국정보기술학회논문지
2013 .01
모듈러 곱셈을 위한 고정 - 크기 시스톨릭 어레이(fixed size systolic array) 설계
한국정보과학회 학술발표논문집
1995 .10
시스톨릭 어레이 유도를 위한 공간 행렬 결정 방법
정보과학회논문지(A)
1999 .02
시스톨릭 어레이 설계 및 검증 시스템의 구현
정보과학회논문지(C)
1998 .04
비동기 회로 및 시스템 설계
[ETRI] 전자통신동향분석
1998 .02
시각적으로 표현한 시스톨릭 어레이 시뮬레이터
대한전자공학회 학술대회
1993 .11
시각적으로 표현한 시스톨릭 어레이 시뮬레이터 ( Graphical Systolic Array Simulator )
대한전자공학회 학술대회
1993 .11
Performance Analysis of Array Processing Techniques for GNSS Receivers under Array Uncertainties
Journal of Positioning, Navigation, and Timing
2017 .01
동기와 비동기의 차이
정보화사회
1996 .01
역전파 신경망 모델을 위한 시스톨릭 배열의 설계 및 성능 분석
(구)정보과학회논문지
1992 .07
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