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논문 기본 정보
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- Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1990년도 봄 학술발표논문집 제17권 제1호
- 발행연도
- 1990.4
- 수록면
- 399 - 402 (4page)
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본 연구는 하드웨어 설계자동화 분야에서 요구되고 있는 HDL 언어 중 IEEE에서 표준화한 VHDL 언어를 사용하기 위한 지원 환경 중에서 VHDL source program을 입력으로 받아 중간코드를 생성하는 Analyzer 시스팀을 구축하기 위한 중간코드에 관한 연구이다. 각 tool들 사이에 공유되어 사용될 중간코드의 설계를 위해 VHDL 언어의 formal definition에 따라 IDL 언어로 기술하여 중간코드를 설계한다. 연구의 내용은 중간코드의 배경과 개념, 설계 방법 및 절차를 기술하고 현재 사용중인 중간코드의 종류를 분석하고 있으며, VHDL 언어를 사용하여 중간코드를 생성하여 보았다. 이러한 VHDL 중간 코드는 내부적으로는 graph 형태를 띠고 있으며 외부적으로는 사용자가 인식할 수 있는 텍스트 형태의 파일로 나타낸다.
목차
요약
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
Ⅳ. 참고 문헌
참고문헌 (0)
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