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- Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1992년도 가을 학술발표논문집 제19권 제2호
- 발행연도
- 1992.10
- 수록면
- 303 - 306 (4page)
이용수
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병렬처리에서 중요한 문제로 부각되는 것이 계산시간(Computation Time)이다. 본 논문에서는 지금까지 개발되어 오고있는 하드웨어 특성에 맞추어 전달 지연 시간을 감소시킨 종래의 AND gate 위주의 설계에서 NAND 게이트 설계로 변환시킨 5-by-52의 보수 멀티플라이어를 제안 설계하여 그에대한 다른것들과의 Time-Area 측정 비교와 CMOS 설계 이 아웃을 제시하였다.
목차
요약
1. 서론
2. General Array Multipliers
3. 2의 보수의 New Array Multiplier.
4. 제안된 멀티플라이어의 CMOS 레이 아웃 설계
5. Time - Arae 비교 측정
References
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