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논문 기본 정보

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한국통신학회 한국통신학회논문지 한국통신학회논문지 제30권 3A호
발행연도
2005.3
수록면
226 - 232 (7page)

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JTAG 기반 SoC의 디버깅 성능향상을 위한 온 칩 디버깅 유닛(On-chip debugging unit)을 제안하였다. 제안된디버깅 유닛은 JTAG 모듈, 코어브레이커로 구성된다. JTAG 모듈은 기존의 IEEE 1149.1 표준을 변형하여 효율적으로 설계하였다. SoC 시스템의 집적도가 높아질수록 1회의 디버깅 사이클을 실행하기 위한 반복적인 TAP 명령의 인가가 예상된다. 제안된 디버깅 유닛이 TAP 명령 인가과정의 불필요한 클럭 소모를 최소화하였다. 성능분석 결과 기존의 방식과 비교하여 14% 정도의 디버깅 성능의 증가를 보였고 TAP 컨트롤러 회로의 게이트 수는 50% 정도 감소하였다.

목차

요약

ABSTRACT

Ⅰ. 서론

Ⅱ. 디버깅 시스템

Ⅲ. 제안된 TAP 컨트롤러

Ⅳ. 데모시스템

Ⅴ. 결론

참고문헌

저자소개

참고문헌 (9)

참고문헌 신청
B. Hailpern, P. Santhanam, "Software debugging, testing, and verification," IBM Systems Journal, vol. 41, pp. 4-12, 2002 google schola A.J. Albee, M. Ellis, "Basic boundary-scan for in-circuit test," IEEE Proceedings of ETC 1994, pp. 349-354, Apr. 1993 google schola K. P. Parker, The Boundary Scan Handbook, Kluwer Academic Publishers, 2003 google schola J. Beck, R. Rose, "Integrated test logic for video IC's," IEEE Proceedings of Test Conference 1998, pp. 744-751. Sept. 1998 google schola IEEE Std 1149.1-2001, Test Port and Boundary-Scan Architecture, IEEE, 2001 google schola

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