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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.7
- 수록면
- 65 - 75 (11page)
이용수
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SoC 설계기술이 발전함에 따라 디버깅이 차지하는 비중은 더욱더 증가되고 있으며 사용자는 빠르고 정확한 디버거를 원하고 있다. 본 논문에서는 새로 설계되는 RISC 프로세서에 적용할 디버거를 위한 변형된 JTAG을 제안 및 설계하여 디버깅 기능 수행에 필요한 사이클을 줄임으로써 빠른 디버거를 구현하였다. 구현된 JTAG은 Core-A의 OCD에 내장하여 SW 디버거와 연동하여 FPGA 레벨까지 검증 마치고 디버거로서의 기능 및 신뢰성을 확인하였다. Core-A의 OCD에 내장된 제안한 JTAG은 기존의 JTAG과 비교하였을 경우, 디버깅 수행 사이클은 수행되는 디버깅 기능에 따라 약 8.5～72.2% 감소되고 추가적으로 게이트 카운트도 약 31.8%감소되었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. JTAG
Ⅲ. 제안한 TAP 블록
Ⅳ. 구현 및 성능 비교
Ⅴ. 검증
Ⅵ. 결론
참고문헌
저자소개
참고문헌 (9)
참고문헌 신청
1. [학술지(정기간행물)] - 허경철 / 2010 / Core-A를 위한 효율적인 On-Chip Debugger 설계 및 검증 / 전자공학회논문지 - SD 47 (4) : 50 ~ 61
2. [학술대회논문] - G.R. Alves / 1999 / From Design-for-Test to Design-for-Debug-and-Test: Analysis of Requirements and Limitations for 1149.1 / Proc. 17th IEEE VLSI Test Symp. (VTS99) : 473 ~ 480
3. [기타자료] - / 1993 / Test Access Port and Boundary-Scan Architecture / IEEE Std. 1149.1a-1993
4. [인터넷자원] - / / www.core-a.net
5. [학술지(정기간행물)] - 박형배 / 2009 / GNU 디버거를 이용한 온칩 디버깅 시스템 설계 / 전자공학회논문지 - SD 46 (1) : 24 ~ 38
2. [학술대회논문] - G.R. Alves / 1999 / From Design-for-Test to Design-for-Debug-and-Test: Analysis of Requirements and Limitations for 1149.1 / Proc. 17th IEEE VLSI Test Symp. (VTS99) : 473 ~ 480
3. [기타자료] - / 1993 / Test Access Port and Boundary-Scan Architecture / IEEE Std. 1149.1a-1993
4. [인터넷자원] - / / www.core-a.net
5. [학술지(정기간행물)] - 박형배 / 2009 / GNU 디버거를 이용한 온칩 디버깅 시스템 설계 / 전자공학회논문지 - SD 46 (1) : 24 ~ 38
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