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대한전자공학회 전자공학회논문지-SC 전자공학회논문지 제39권 SC편 제1호
발행연도
2002.1
수록면
66 - 75 (10page)

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IEEE 802.11a에 의해 규정되어진 데이터 전송속도 12Mbps, 부호화 율 1/2, 구속장이 7인 무선 LAN용 비터비 디코더의 이론적인 성능분석을 위해서 Cramer법칙을 이용하여 전달함수를 구하고 가산성 백색 가우시안 잡음 환경하에서 각 구속장 별 첫 번째 사건에서의 에러 확률과 비트 에러 확률을 구하였다. 설계과정에서는 4 비트 연성판정을 위해 입력 심볼을 16단계로 양자화 하였으며, 역 추적을 위한 방식으로 메모리를 사용하는 대신 레지스터 교환방식을 사용함으로써 다수결 결정이 가능한 구조를 제시하였다. 구현과정에서는 12Mbps 고속의 데이터를 처리하기 위해 파이프 라인을 적용한 병렬구조를 갖는 비터비 디코더와 가산성 백색 가우시안 잡음 설계를 FPGA 칩을 사용하여 구현하여 실시간 환경에서 성능검증을 하였다

목차

Ⅰ. 서론

Ⅱ. 구속장 k=7인 무선 LAN용 비터비

Ⅲ. 비터비 복호기의 세부설계

Ⅳ. 하드웨어제작에 의한 실시간 성능검증

Ⅴ. 결 론

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