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디지털 지연동기루프의 설계 및 구현에 관한 연구 ( Design and Implementation of Digital Delay Locked Loop )
한국통신학회 학술대회논문집
1995 .01
디지털 지연동기루프의 설계 및 구현 ( Design and Implementation of Digital Delay Locked Loop )
한국통신학회논문지
1996 .08
도플러 효과에 의한 지연 동기 루프의 추적 성능분석 ( Influence of Doppler Effects on the Tracking Performance of a Delay Locked Loop )
한국통신학회논문지
1998 .04
저전력 1.8V, 광대역 50~500㎒ 지연동기루프의 구현
대한전자공학회 학술대회
2001 .11
n - Δ delay-Lock Loops의 성능 해석 ( Performance Analysis of Extended n - Δ Delay-Lock Loops )
전자공학회지
1981 .02
Delay Locked Loop Design Issues
대한전자공학회 ISOCC
2004 .10
PERFORMANCE ANALYSIS OF EXTENDED N-Δ DELAY-LOCK LOOPS
대한전자공학회 심포지엄 논문집
1980 .01
디지털 위상고정루프의 설계 및 성능분석
한국통신학회 학술대회논문집
2003 .07
GPS 수신 시스템에서 디지털 지연동기 루프 회로 설계 및 분석 ( The Circuit Design and Analysis of the Digital Delay-Lock Loop in GPS Receiver System )
한국통신학회논문지
1994 .08
위상지연을 이용한 Integer-N 방식의 위상ㆍ지연고정루프 설계
전자공학회논문지-SD
2010 .06
위상 고정 루프 (Phase Locked Loop)의 모델링
대한전자공학회 학술대회
2018 .06
루프지연 보상을 고려한 상향링크 폐루프 전력제어 알고리듬
한국통신학회 학술대회논문집
2001 .11
이중루프 위상ㆍ지연고정루프 설계
한국정보통신학회논문지
2011 .07
새로운 Locking 알고리즘을 이용한 DLL(Delay - Locked - Loop) 설계
대한전자공학회 학술대회
2000 .11
비선형 필터를 이용한 GPS 코드 지연 추적 루프
제어로봇시스템학회 국내학술대회 논문집
2007 .05
낮은 잡음 특성을 가지기 위해 이중 루프의 구조를 가지는 위상고정루프 구현
한국정보통신학회논문지
2016 .04
지연고정루프를 이용한 1㎲ 아래의 위상고정시간을 가지는 Integer-N 방식의 위상고정루프 설계
한국정보통신학회논문지
2009 .11
루프인식 속도를 개선한 CMOS 위상고정루프 (PLL)의 설계
대한전자공학회 학술대회
1994 .11
루프인식 속도를 개선한 CMOS 위상고정루프 ( PLL ) 의 설계 ( A Design of CMOS Phase-Locked Loop with Improved Lock-in Speed )
대한전자공학회 학술대회
1994 .11
다중 클락 주기의 지연체인을 이용한 정밀한 지연발생 회로
전기전자학회논문지
1999 .07
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