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저자정보
천송이 (인천대학교) 이윤상 (인천대학교) 김봉수 (인천대학교) 송준영 (인천대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 추계학술대회 논문집
발행연도
2024.11
수록면
136 - 139 (4page)

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The presented digital low-dropout regulator (DLDO) dynamically adjusts the clock frequency by monitoring the difference between the reference and feedback voltages. This adaptive frequency control allows the DLDO to efficiently handle voltage ringing events, enabling a faster transient response. In contrast to previous designs that rely on two voltage-controlled oscillators (VCOs) for frequency generation to manage pass gates, this approach simplifies the design by utilizing a single VCO, thereby minimizing the number of VCO control voltage pins required. The proposed DLDO regulates a 1 V output from a 1.2 V input and is fabricated using a 65nm CMOS process. It achieves a transient response time of 782ns, a peak power efficiency of 99.93%, and a figure of merit (FOM) of 11.3fs.

목차

Abstract
I. 서론
II. 본론
III. 구현
IV. 결론 및 향후 연구 방향
참고문헌

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