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논문 기본 정보

자료유형
학술저널
저자정보
최준백 (Ranix) 신경욱 (Kumoh National Institute of Technology)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제25권 제8호
발행연도
2021.8
수록면
1,095 - 1,102 (8page)

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이 논문의 연구 히스토리 (2)

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성능과 하드웨어 복잡도 사이에 높은 확장성과 유연성을 갖는 확장 가능형 ECC 구조를 제안한다. 구조적 확장성을 위해 유한체 연산을 32 비트 워드 단위로 병렬 처리하는 처리요소의 1차원 배열을 기반으로 모듈러 연산회로를 구현하였으며, 사용되는 처리요소의 개수를 1~8개 범위에서 결정하여 회로를 합성할 수 있도록 설계되었다. 이를 위해 워드 기반 몽고메리 곱셈과 몽고메리 역원 연산의 확장 가능형 알고리듬을 적용하였다. 180-nm CMOS 공정으로 확장 가능형 ECC 프로세서 (sECCP)를 구현한 결과, N<SUB>PE</SUB>=1인 경우에 100 kGE와 8.8 kbit의 RAM으로 구현되었고, N<SUB>PE</SUB>=8 인 경우에는 203 kGE와 12.8 kbit의 RAM으로 구현되었다. sECCP가 100 MHz 클록으로 동작하는 경우, N<SUB>PE</SUB>=1 인 경우와 N<SUB>PE</SUB>=8인 경우의 P256R 타원곡선 상의 점 스칼라 곱셈을 각각 초당 110회, 610회 연산할 수 있는 것으로 분석되었다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 타원곡선 암호
Ⅲ. 확장 가능형 ECC 프로세서 설계
Ⅳ. 검증 및 성능평가
Ⅴ. 결론
REFERENCES

참고문헌 (14)

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