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논문 기본 정보

자료유형
학술대회자료
저자정보
김호준 (포항공과대학교) 박홍준 (포항공과대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2020년도 대한전자공학회 추계학술대회 논문집
발행연도
2020.11
수록면
68 - 71 (4page)

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이 논문의 연구 히스토리 (2)

2021

PVT-insensitive Time-to-Digital Converter for All-synthesizable ADPLL
김호준 전자전기공학과 2021.01 학위논문

2020

All - synthesizable ADPLL을 위한 PVT 변화에 둔감한 Time to Digital Converter
김호준 ,  박홍준 대한전자공학회 학술대회 2020.11 학술대회자료

초록· 키워드

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This paper presents the process, voltage and temperature (PVT) - insensitive time-to-digital converter (TDC) for 480㎒ all-synthesizable All-Digital-Phase Lock Loop (ADPLL). The proposed TDC consists of TDC core (25 stage buffers), PVT detector (PVTDet) and 15 look up tables (LUT) which determines the optimal number of buffer stages depending on the PVTDet output. We measured the RMS jitter of the ADPLL for a total of 6 chips fabricated in a 65nm CMOS process with VDD from 0.9 to 1.1 V in 0.05 V step. The measured RMS jitter ranged 7.23 ps (0.34% UI) and below for all the cases. These results demonstrate the successful operation of the proposed TDC under the PVT variations.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 구현
Ⅳ. 결론 및 향후 연구 방향
참고문헌

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