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논문 기본 정보

자료유형
학술저널
저자정보
박철현 (Korea Aerospace University) 정용철 (Korea Aerospace University) 정윤호 (Korea Aerospace University)
저널정보
한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제24권 제3호
발행연도
2020.9
수록면
838 - 844 (7page)

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이 논문의 연구 히스토리 (2)

2021

블루투스 저전력 시스템을 위한 저복잡도 결합 비터비 검출 및 복호 알고리즘의 하드웨어 설계에 관한 연구
박철현 항공전자정보공학과 2021.01 학위논문

2020

블루투스 저전력 시스템을 위한 저복잡도 결합 비터비 검출 및 복호 알고리즘의 하드웨어 설계 및 구현
박철현 ,  정용철 ,  정윤호 전기전자학회논문지 2020.09 학술저널

초록· 키워드

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본 논문에서는 검출과 복호가 결합된 효율적인 비터비 알고리즘 (joint Viterbi detection and decoding (JVDD))의 저복잡도 하드웨어 설계 및 구현 결과를 제시한다. 길쌈부호화된 GMSK 신호가 BLE 5.0 표준으로 채택 되어있으므로 검출과 복호를 위해 두개의 비터비 프로세서가 필요하다. 그러나, 제안된 JVDD 알고리즘은 GMSK에 의해서 유발된 심볼간의 간섭정보(ISI：inter-symbol interference)가 반영된 가지 메트릭 (branch metric)을 사용하여 단지 하나의 비터비 만을 사용하여도 검출과 복호 수행이 가능하며, 성능 저하 없이 복잡도 감소가 가능하다. JVDD 알고리즘을 적용한 BLE 비터비 복호기의 하드웨어 구현을 위해 효율적인 구조 설계가 수행되었다. 제안된 구조는 1 클럭 사이클 동안 복호를 완료할 수 있기 때문에 저지연 및 저면적 구현이 가능하다. 제안된 비터비 복호기는 Verilog-HDL을 이용하여 RTL 설계되었고, GF 55nm 공정을 활용하여 논리합성 및 구현되었다. 합성결과 12K 게이트 수를 포함하였으며 메모리 유닛 및 초기 지연시간은 MSE (modified state exchange) 대비 33% 감소 가능함을 확인하였다.
#BLE #ISI #JVDD #TraceBack #Viterbi

목차

Abstract
요약
Ⅰ. 서론
Ⅱ. JVDD 알고리즘
Ⅲ. 제안된 비터비 프로세서
Ⅳ. 결론
References

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