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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2020.8
- 수록면
- 113 - 116 (4page)
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In order to tackle many complicated design rule violation problems in the 10nm and below technology nodes, diverse structures of electrically-equivalent standard cells are necessary rather than using single and compact standard cells. In this paper, we propose a method of exploiting various transistor placement sequences to produce as many different layouts as possible. Through experiments, it is observed that it is feasible to generate various shapes of cells with different transistor orders while maintaining the cell area minimally.
목차
Abstract
I. 서론
II. 본론
III. 실험 환경 및 결과
IV. 결론
참고문헌
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