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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2003.1
- 수록면
- 1 - 7 (7page)
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In this paper, we design the pattern generator circuits using PLDs(Programmable Logic Devices). The pattern generator is the circuit which generates the test pattern signal for the inspection of logical defects of semiconductor products. The proposed circuits are designed by the PLD design tool(MAX+ II of ALTERA). Also the designed circuits are simulated for the verification of the designed ones. The simulation results have a good performance.
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