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논문 기본 정보

자료유형
학술저널
저자정보
신현준 (Chips&Media) 이주흥 (Hongik University)
저널정보
한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제24권 제1호
발행연도
2020.3
수록면
186 - 193 (8page)

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이 논문의 연구 히스토리 (2)

2020

Zynq SoC에서 재구성 가능한 하드웨어 가속기를 지원하는 멀티쓰레딩 시스템 설계
신현준 ,  이주흥 전기전자학회논문지 2020.03 학술저널
Zynq SoC에서 재구성 가능한 하드웨어 가속기를 지원하는 멀티쓰레딩 시스템 설계
신현준 전자전산공학과 2020.01 학위논문

초록· 키워드

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본 논문에서는 Zynq SoC 환경에서 재구성 가능한 하드웨어 가속기를 지원하는 멀티쓰레딩 시스템을 제안한다. 압축된 정지 영상의 픽셀 데이터를 복원하는 고성능 JPEG 디코더를 구현하고 2D-IDCT 함수를 재구성 가능한 하드웨어 가속기로 설계하여 성능을 검증한다. 구현된 시스템에서 최대 4개의 재구성 가능한 하드웨어 가속기는 소프트웨어 쓰레드와 동기화되어 연산을 수행할 수 있으며 이미지 해상도와 압축률에 따라 다른 성능 향상을 보인다. 1080p 해상도 영상의 경우 17:1의 압축률에서 최대 79.11배의 성능 향상과 99fps의 throughput 속도를 보여준다.
#HW/SW co-design #Reconfigurable hardware accelerator #Multi-threaded system #Image processing #JPEG

목차

Abstract
요약
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
References

참고문헌 (0)

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