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논문 기본 정보

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학술저널
저자정보
신예린 (Chungnam national University) 최소연 (Chungnam national University) 유호영 (Chungnam national University)
저널정보
한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제23권 제4호
발행연도
2019.12
수록면
173 - 179 (7page)

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Polar code의 채널용량 달성 특성은 polar code를 각광 받는 오류 정정 부호로 만들었다. 하지만 충분한 오류 정정 성능은 부호의 길이가 길어졌을 때 달성되는 점근적 속성을 보인다. 따라서 입력 데이터가 길어지는 경우에 대한 초대규모 집적회로 구현을 실현하기 위하여 효율적인 구조가 필요하게 되었다. 기존의 polar code 부호기 구조 중 가장 기본적인 완전 병렬 구조는 직관적이고 구현이 쉽지만 긴 polar code에 높은 하드웨어 복잡성을 보이므로 부적합하다. 그리고 이를 보완하여 제안된 부분 병렬 구조는 하드웨어 면적 측면에서 큰 성과를 얻었으나 그 방식이 일반화되어 있지 않아 설계자에 따라 구조에 변동이 발생할 수 있다. 본 논문에서는 이를 개선하고자 비트 차원의 치환을 위해 제안된 회로 설계법을 polar code에 적용하는 하드웨어 설계법을 제안한다. 제안하는 방법을 polar code의 부호기에 적용함으로써 완전 병렬 부호기만큼 직관적인 구조를 가짐과 동시에 일반화된 polar code 부분 병렬 부호기를 설계할 수 있다.

목차

Abstract
요약
Ⅰ. 서론
Ⅱ. Polar code 부호화 (Polar Encoding)
Ⅲ. 비트 차원의 치환 회로 설계법을 적용한 부분 병렬 polar code 부호기
Ⅳ. 실험 결과
Ⅴ. 결론
References

참고문헌 (11)

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