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이상일 (고려대학교) 이한솔 (고려대학교) 유호영 (광운대학교) 김영민 (광운대학교) 이형민 (고려대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2018년도 대한전자공학회 정기총회 및 추계학술대회
발행연도
2018.11
수록면
1,004 - 1,007 (4page)

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In this paper, we analyze the reverse engineering tools for FPGA devices and experimentally verify their performance and limitations. The paper introduces the design flow for Xilinx FPGAs with emphasis on Xilinx Design Language (XDL), XDL Report (XDLRC), and bitstream. Then, existing reverse engineering tools, which utilize the bitstream to recover the netlist, are analyzed with quantitative comparison of measured recovery rates.

목차

Abstract
I. Introduction
II. Xilinx FPGA Design
Ⅲ. Reverse Engineering Tools
Ⅳ. Conclusion
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정민영 ,  이재흠 ,  장영조 외 2명 한국콘텐츠학회논문지 2018 .01

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