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이 논문의 연구 히스토리 (3)
2015
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본 논문은 클럭 게이팅 구동신호를 이용한 전력 모델링 방법에서 회로에서 나타나지 않는 잉여 전력 상태를 확인함으로써 전력 상태 수를 줄이는 방법을 제안한다. 회로에 나타나지 않는 전력 상태를 확인하기 위해 함수적 종속성과 구조적 종속성을 확인한다. 본 논문에서는 2개의 클럭 게이팅 구동신호 간에 나타나는 함수적 종속성 중 동치 관계, 역관계, 포함 관계만을 다룬다. 구조적 종속성은 클럭 게이팅 셀의 위치적 특성에 의한 종속성을 의미한다. 두 종속성으로 발견한 관계를 이용해 전력 상태의 수를 줄였으며, 감소 후 남은 전력 상태수를 세기위해 이진결정다이어그램을 사용하였다. 함수적 종속성과 구조적 종속성을 이용해 전력 상태 수를 알고리즘 적용 전 대비 평균 59%까지 감소시켰다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 클럭 게이팅
Ⅲ. 본문
Ⅳ. 실험 결과
Ⅴ. 결론
REFERENCES
참고문헌 (18)
참고문헌 신청
[학술대회논문] - C. M. Lee / 2013 / A Basic-block Power Annotation Approach for Fast and Accurate Embedded Software Power Estimation / the International Conference on VLSI : 118 ~ 123
[단행본] - G. Vijin / 2001 / The Computer Engineering Handbook / CRC Press
[학위논문] - H. Choi / 2015 / Reduction of the Number of Power States for High-level Power Models based on Clock Gating Signals / Kwangwoon university
[학술대회논문] - N.F. Ghohroud / 2014 / Back-annoation of Gate-level Power Properties into System Level Descriptions / ICCC New Circuits and Systems Conference 12th : 237 ~ 240
[학술대회논문] - I. Lee / 2006 / Powervip: Soc power estimation framework at transaction level / Proc. of South Pacific Design Automation Conference : 551 ~ 558
[단행본] - G. Vijin / 2001 / The Computer Engineering Handbook / CRC Press
[학위논문] - H. Choi / 2015 / Reduction of the Number of Power States for High-level Power Models based on Clock Gating Signals / Kwangwoon university
[학술대회논문] - N.F. Ghohroud / 2014 / Back-annoation of Gate-level Power Properties into System Level Descriptions / ICCC New Circuits and Systems Conference 12th : 237 ~ 240
[학술대회논문] - I. Lee / 2006 / Powervip: Soc power estimation framework at transaction level / Proc. of South Pacific Design Automation Conference : 551 ~ 558
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