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논문 기본 정보
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- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC 2015
- 발행연도
- 2015.6
- 수록면
- 786 - 789 (4page)
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This paper presents further studies on Scalable-Delay-Insensitive (SDI) optimization, an approach to revise Signal Transition Graph (STG) in order to relieve a restricted and pessimistic delay model for asynchronous control circuit synthesis. This paper extends the new algorithm based on the lock relation which analyze a causal relation to determine the signal transitions to be optimized and their safeness properties in case the STG has multiple tokens of initial marking. The proposed algorithm can be satisfied to properties of STG. Furthermore, it is not only performed to single cycle signal but also to multiple cycle signal STGs. As the results, our method can reduce the overhead from original STG used and implement the circuits which operate correctly.
목차
Abstract
1. Introduction
2. Signal Transition Graph and Lock relation
3. Scalable-Delay-Insensitive (SDI) Model and Concurrent Transition Model
4. SDI Optimization based on lock relation
5. Experiments Result and Conclusion
References
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