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이용수
ABSTRACT
1. 서론
2. 본론
3. 결론
참고문헌
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900MHz대 주파수 동작특성을 갖는 위상동기 루프회로의 매크로 모델링에 관한 연구 ( A Study on the Macro Modeling of Phase-Looked Loop Circuit with 900MHz Frequency Characteristics )
대한전자공학회 학술대회
1994 .11
380MHz CMOS 위상동기 루프 회로 설계에 관한 연구
대한전자공학회 학술대회
1996 .01
낮은 위상 잡음 성능을 갖는 875MHz 위상 동기 발진기의 구현 ( Implementation of 875MHz Phase locked Oscillator with low Phase Noise )
대한전자공학회 학술대회
1994 .11
매크로모델을 이용한 900MHz 대 PLL 회로의 설계
대한전자공학회 학술대회
1995 .01
루프인식 속도를 개선한 300MHz CMOS PLL의 설계 및 제작
대한전자공학회 학술대회
1995 .12
루프인식 속도를 개선한 300MHz CMOS PLL의 설계 및 제작 ( A 300MHz CMOS Phase-Locked Loop with Improved Pull-in Process )
전자공학회논문지-A
1996 .10
루프인식 속도를 개선한 300MHz CMOS PLL의 설계 및 제작 ( A 300MHz CMOS Phase-Locked Loop with Improved Pull-in Process )
대한전자공학회 학술대회
1995 .11
위상 고정 루프 (Phase Locked Loop)의 모델링
대한전자공학회 학술대회
2018 .06
고속 위상 동기 루프를 위한 새로운 구조의 위상/주파수 검출기 ( New Phase/Frequency Detectors for High-Speed Phase-Locked Loop Application )
전자공학회논문지-C
1998 .08
PLL을 이용한 100Mhz-750Mhz Clock 복원 회로 ( A PLL Based 100 MHz-750 MHz Clock Recovery Circuit )
대한전자공학회 학술대회
1998 .01
Design of Low Power 1.8V, Wide Range 50~500MHZ Delay Locked Loop
대한전자공학회 기타 간행물
2001 .11
낮은 잡음 특성을 가지기 위해 이중 루프의 구조를 가지는 위상고정루프 구현
한국정보통신학회논문지
2016 .04
위상 주파수 검출 가능한 시간 디지털 변환기를 이용한 빠른 위상 동기 디지털 위상 동기 루프
대한전자공학회 학술대회
2012 .11
기생 소자를 이용한 휴대 단말기용 RFID 리더 안테나
한국항행학회논문지
2007 .01
A 300MHz-800MHz Low Jitter Injection Locked Frequency Multiplier for Low Power applications
대한전자공학회 학술대회
2019 .11
선택적으로 클럭 신호를 입력하는 저 전력 전류구동 디지털-아날로그 변환기
전자공학회논문지-SD
2011 .10
디지털 로직을 통해 빠른 주파수 고정이 가능한 875MHZ Sub-Sampling 위상 고정 루프
대한전자공학회 학술대회
2019 .11
위상선택회로를 이용한 600㎒~1.7㎓ 디지털 지연고정루프
한국정보기술학회논문지
2011 .06
50MHz~600MHz의 동작 주파수 범위를 갖는 CMOS Charge Pump PLL 설계
한국통신학회 학술대회논문집
2004 .07
30 ~ 1000 MHz 주파수 범위에서의 전자기장의 세기 표준 ( Field Strength Standard in 30 ~ 1000 MHz Frequency Range )
한국통신학회논문지
1993 .12
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