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This paper describes a low-voltage dynamic random-access memory (DRAM) focusing on subthreshold leakage reduction during self-refresh (sleep) mode. By sharing a power switch, multiple iterative circuits such as row and column decoders have a significantly reduced subthreshold leakage current. To reduce the leakage current of complex logic gates, dual channel length scheme and input vector control method are used. Beca ... 전체 초록 보기

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
참고문헌

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