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2015
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본 논문에서는 직렬 십진 곱셈기의 성능을 향상시키는 방안을 제안하고 다중 digit을 동시에 연산하는 방안을 제안한다. 제안하는 직렬 십진 곱셈기는 부분 곱 생성단계의 2배수, 4배수를 생성하기 위한 인코딩 모듈을 없애고 쉬프트 연산만으로 부분 곱을 생성해 지연시간을 감소시킨다. 또한 다중 digit 연산을 이용해 연산의 횟수를 줄인다. 제안하는 직렬 십진 곱셈기의 성능을 평가하기 위해서 Synopsys사의 Design Compiler를 이용하여 SMIC사의 110nm CMOS 공정 라이브러리로 합성하였다. 그 결과 제안한 곱셈기는 기존의 직렬 십진 곱셈기와 비교해 전체 면적은 4% 증가하였지만, 전체 지연시간은 5% 감소함을 보였다. 또한 동시 연산 수가 증가함에 따른 제안한 다중 digit 곱셈기의 면적과 지연시간의 trade-off를 확인하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 관련 연구
Ⅲ. 효율적인 배수 생성을 이용한 직렬 십진 곱셈기
Ⅳ. 다중 digit을 이용한 직렬 십진 곱셈기
Ⅴ. 성능 분석
Ⅵ. 결론
REFERENCES
참고문헌 (10)
참고문헌 신청
1. [학술대회논문] - H. A. H. Fahmy / 2010 / Decimal Floating Point for future processors / IEEE International Conference Microelectronics(ICM '09) : 443 ~ 446
2. [학술대회논문] - H. A. H. Fahmy / 2009 / Energy and Delay Improvement via Decimal Floating Point Units / proceedings of 19th IEEE International symposium Computer Arithmetic (ARITH '09) : 221 ~ 224
3. [기타자료] - IEEE / 1985 / IEEE 754 Standard for Binary Floating-Point Arithmetic
4. [기타자료] - IEEE / 2008 / IEEE 754-2008 Standard for Floating-Point Arithmetic
5. [학술대회논문] - C. Coulston / 2012 / Addition of BCD Digits using Non-Standard Codes / 22nd International Conference : 148 ~ 152
2. [학술대회논문] - H. A. H. Fahmy / 2009 / Energy and Delay Improvement via Decimal Floating Point Units / proceedings of 19th IEEE International symposium Computer Arithmetic (ARITH '09) : 221 ~ 224
3. [기타자료] - IEEE / 1985 / IEEE 754 Standard for Binary Floating-Point Arithmetic
4. [기타자료] - IEEE / 2008 / IEEE 754-2008 Standard for Floating-Point Arithmetic
5. [학술대회논문] - C. Coulston / 2012 / Addition of BCD Digits using Non-Standard Codes / 22nd International Conference : 148 ~ 152
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