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논문 기본 정보

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학술저널
저자정보
김효중 위재경 (숭실대학교) 송인채 (숭실대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제52권 3호
발행연도
2015.3
수록면
59 - 66 (8page)

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본 논문에서는 4bit SAR-ADC(Successive Approximation ADC) 기반의 LDO(Low Drop-Out Regulator)와 파워 트랜지스터의 사이즈 선택을 통하여 DC-DC 벅 컨버터의 효율을 개선하는 방법을 제안한다. 제안하는 회로는 부하 전류에 따라서 파워 트랜지스터 사이즈를 선택하여 DC-DC 벅 컨버터의 효율을 개선한다. 이를 위해, 우리는 스위칭 손실과 전도 손실이 교차하는 지점을 파워 트랜지스터의 적절한 사이즈로 선택하였다. 또한, standby mode 또는 sleep mode로 동작 시에는 효율을 개선하기 위해 LDO로 동작하도록 하였다. 제안하는 회로는 4bit로 파워 트랜지스터 사이즈(X1, X2, X4, X8)를 선택하였고, 저부하에서 단일 사이즈를 이용한 기존의 방식보다 최대 25%의 효율 개선을 얻을 수 있었다. 입력 전압은 5V, 출력 전압은 3.3V, 최대 부하 전류는 500㎃이다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 일반적인 DC-DC 벅 컨버터의 손실
Ⅲ. 파워 트랜지스터 사이즈 변화 기법을 이용한 DC-DC 벅 컨버터
Ⅲ. 시뮬레이션 결과
Ⅳ. 결론
REFERENCES

참고문헌 (14)

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