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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2013.11
- 수록면
- 135 - 138 (4page)
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Recently, the flat panel display resolution is up to UHD (Ultra high Definition) and the application needs to meet the narrow vessel. To meet the narrow vessel is restricted a Intra Panel wiring, in addition to meet the UHD resolution, the data transfer rate must be increased. Accordingly the Intra-Panel Interface of Source Driver IC is changed to the Point-to-Point Clock Embedded Interface by using DLL (Delay-Locked Loop). The setup and hold time is restricted due to increasing data transfer rate for the highresolution and the narrow vessel. So we need to design a DLL with low jitter characteristic. In this paper, we propose a new architecture of charge pump that is reduced jitter characteristic of DLL. The proposed low jitter charge pump has been designed by 0.18μm 1-poly 3-metal CMOS technology and simulated by HSPICE. From the simulation results, it is shown that the jitter of DLL is 2.667ps.
목차
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 구현
Ⅳ. 결론 및 향후 연구 방향
참고문헌
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