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논문 기본 정보

자료유형
학술저널
저자정보
하창수 (동의대학교) 최병윤 (동의대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제13권 제12호
발행연도
2009.12
수록면
2,569 - 2,578 (10page)

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Core-A 마이크로프로세서는 32-bit RISC 구조의 국산 임베디드 마이크로프로세서로서 특허청의 지원을 받아 KAIST의 주관아래 개발된 프로세서이다. 본 논문에서는 Core-A 마이크로프로세서와 코프로세서간의 인터페이스 방안에 대하여 분석하고 효율적 인구조를 제안한다. 인터페이스 방안의 검증을 위해 코프로세서로 사용된 AES 암호 프로세서는 128-bit의 키와 블록을 갖는 대칭키 암호 알고리즘이다. 코프로세서 인터페이스 회로와 AES 암호프로 세서는 Verilog-HDL로 작성되었으며, Modelsim 시뮬레이터를 사용하여 시뮬레이션을 수행하였다. 삼성 0.35um CMOS 표준 셀 라이브러리를 사용하여 AES를 제외한 코프로세서 인터페이스 부분을 합성한 결과 약 90Mhz의 동작 주파수를 가지며, 3743개의 게이트수로 구성되었다. 본 논문에서 구현한 코프로세서 인터페이스 회로는 Core-A와 코프로세서간의 효율적인 명령어 및 데이터 전달을 수행할 수 있다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. Core-A 구조
Ⅲ. 코프로세서를 위한 Core-A의 버스 인터페이스 구조
Ⅳ. 코프로세서 인터페이스 설계
Ⅴ. AES 코프로세서 설계
Ⅵ. 코프로세서 인터페이스와 AES의 통합 설계 검증 및 시뮬레이션
Ⅶ. 결론
참고문헌

참고문헌 (8)

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