통신 시스템을 위한 고성능 재구성 가능 코프로세서의 설계

정철윤; 선우명훈

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자료유형: 학술저널

저자정보: 정철윤 선우명훈

저널정보: 대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제6호

발행연도: 2005.6

수록면: 39 - 48 (10page)

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본 논문은 통신 시스템에서 요구하는 다양한 연산과 고속의 동작을 수행할 수 있는 재구성 가능 코프로세서를 제안 하였다. 제안된 재구성 가능 코프로세서는 스크램블링, 인터리빙, 길쌈부호화, 비터비 디코딩, FFT 등과 같은 통신 시스템에 필수적인 연산 동작을 쉽게 구현할 수 있는 특징을 가진다. 제안된 재구성 가능 코프로세서는 VHDL로 설계하여 SEC 0.18㎛ 표준셀 라이브러리를 이용해 합성하였으며, 총 35,000 게이트에 3.84ns의 최대 동작 속도를 보였다. 제안된 코프로세서에 대한 성능검증 결과 IEEE 802.11a WLAN 표준에 대해 기존 DSP에 비해서 FFT 연산과 Complex MAC의 경우 약 33%, 비터비 디코딩의 경우 약 37%, 스크램블링 및 길쌈부호화의 경우 약 48%～84%의 연산 사이클 감소를 확인하였으며 다양한 통신 알고리즘에 대해 기존 DSP보다 우수한 성능을 나타내었다.

참고문헌 (16)

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[학술지(정기간행물)] - C. L. Wang / 1999 / A novel DHT-based FFT/IFFT processor for ADSL transceivers : 51 ~ 54

[학술지(정기간행물)] - VDSL Alliance / April1999. / VDSL Alliance Draft Standard Proposal

[학술지(정기간행물)] - IEEE Std 802.11a-1999 / Sep.1999. / Part 11: Wireless LAN Medium Access Control and Physical Layer specifications

[학술지(정기간행물)] - J. R. Choi / 2000 / A 2048 complex point FFT architecture for digital audio broadcasting system v : 693 ~ 696

[학술지(정기간행물)] - ETSI EN 300 744 v1.4.1 / Jan.2001. / Channel Coding and Modulation for Digital Terrestrial Television

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선우명훈

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