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논문 기본 정보

자료유형
학술저널
저자정보
황인국 (인하대학교) 김강희 (인하대학교) 윤완오 (인하대학교) 최상방 (인하대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제50권 3호
발행연도
2013.3
수록면
50 - 58 (9page)

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이 논문의 연구 히스토리 (2)

2013

제한된 범위의 Signed-Digit Number 인코딩을 이용한 병렬 십진 곱셈기 설계
황인국 ,  김강희 ,  윤완오 외 1명 전자공학회논문지 2013.03 학술저널
부호화 자릿수 인코딩을 이용한 병렬 십진 곱셈기 설계
황인국 전자공학과 2013.01 학위논문

초록· 키워드

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본 논문에서는 제한된 범위의 Signed-Digit number 인코딩과 축약 단계를 이용한 고정소수점 병렬 십진 곱셈기를 제안한다. 제안한 병렬 십진 곱셈기는 승수와 피승수를 제한된 범위의 SD number로 인코딩하여 캐리 전달 지연 없이 빠르게 부분곱을 생성한다. 인코딩에 사용하는 숫자의 범위를 줄임으로써 SD number 다중 피연산자 덧셈의 한번에 연산 가능한 피연산자의 개수가 늘어나게 되고, 이에 따라 부분곱 축약 단계의 연산을 빠르게 수행 할 수 있다. 제안한 병렬 십진 곱셈기의 성능 평가를 위해 Design Compiler에서 SMIC사의 180nm CMOS 공정 라이브러리를 이용하여 합성한 결과 기존의 Signed-Digit number를 이용한 병렬 십진 곱셈기보다 전체 지연시간은 4.3%, 전체 면적은 5.3% 감소함을 확인 하였다. 전체 지연시간 및 면적에서 부분곱 축약 단계가 차지하는 비중이 가장 크므로 부분곱 생성 단계에서 약간의 지연시간 및 면적 증가가 있음에도 불구하고 전체 지연시간과 면적이 감소하는 결과를 얻을 수 있다.
#Parallel Decimal Multiplier #IEEE 754-2008 #Signed-Digit Number

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 관련 연구
Ⅲ. 제한된 범위의 SD 인코딩을 이용한 병렬 십진 곱셈기
Ⅳ. 실험 및 성능평가
Ⅴ. 결론
참고문헌

참고문헌 (15)

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1. [인터넷자원] - M. F. Cowlishaw / / The decNumber C Library v3.68 google schola 2. [인터넷자원] - Sun Microsystems / / BigDecimal class, java 2 plaform standard edition 5.0, API specification google schola 3. [인터넷자원] - Intel Corportation / / Intel Decimal Floating-Point Math Library google schola 5. [학술지(정기간행물)] - L. Eisen / 2007 / IBM POWER6 Accelerators : VMX and DFU / IBM J. Research and Development 51 (6) : 663 ~ 684 google schola 6. [학술지(정기간행물)] - A. Y. Duale / 2007 / Decimal Floating-Point in z9 : An Implementation and Testing Perspective / IBM J. Research and Development 51 (1) : 217 ~ 228 google schola

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