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이용수
Abstract
1. Introduction
2. Loop Bandwidth and Phase Margin
3. Proposed PLL Architecture
4. Simulation Results
5. Conclusion
References
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A Fast Locking Phase-Locked Loop
대한전자공학회 학술대회
1996 .01
Locking 상태 표시를 이용한 저잡음 고속 위상고정 루프
한국정보통신학회논문지
2005 .06
A Fast-Locking Phase Locked Loop with Multiple Charge Pumps
ICEIC : International Conference on Electronics, Informations and Communications
2006 .06
Fast locking All-Digital Phase-Locked Loop with Adaptive Loop Gain Control
한국통신학회 학술대회논문집
2019 .01
A JITTER FREE ALL DIGITAL PHASE LOCKED LOOP
ICVC : International Conference on VLSI and CAD
1995 .01
Design of 1.28GHz CMOS Integer-N Phase Locked Loop with Locking Status Indicator
대한전자공학회 ISOCC
2005 .10
A New Phase-Locked Loop System with the Controllable Output Phase and Lock-up Time
제어로봇시스템학회 국제학술대회 논문집
2003 .10
A fast-locking scheme for Phase Locked Loop using adaptive capacitance in Loop Filter
대한전자공학회 ISOCC
2005 .10
Digital Phase Locked Loop에 관한 연구 ( A Study on the Digital phase Locked Loop )
대한전자공학회 학술대회
1984 .01
적은 Reference Spur와 빠른 Lock Time을 갖는 Phase Locked Loop
대한전자공학회 학술대회
2008 .11
능동필터를 이용한 빠른 Lock Time을 갖는 PLL
전자공학회논문지
2018 .10
0.35㎛ CMOS 공정을 이용한 새로운 위상고정 시간이 빠른 위상고정루프
대한전자공학회 학술대회
2007 .11
새로운 듀얼 슬로프 위상 주파수 검출기를 이용한 위상고정 시간이 빠른 위상고정루프
대한전자공학회 학술대회
2007 .07
새로운 듀얼 슬로프 위상 주파수 검출기를 이용한 위상고정 시간이 빠른 위상고정루프
대한전자공학회 학술대회
2007 .07
빠른 lock - on time을 위한 선택적 시작점을 갖는 DLL
대한전자공학회 학술대회
2000 .11
Digital Phase Locked Loop에 관한 연구
대한전자공학회 학술대회
1984 .11
빠른 Lock-Time을 위한 다중 이득 제어 디지털 위상 주파수 검출기
전자공학회논문지
2014 .02
새로운 Locking 알고리즘을 이용한 DLL(Delay - Locked - Loop) 설계
대한전자공학회 학술대회
2000 .11
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