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학술대회자료
저자정보
Chuan Zhang (University of Minnesota) Sang-Min Kim (University of Minnesota) Jin Sha (Nanjing University)
저널정보
대한전자공학회 대한전자공학회 ISOCC ISOCC 2011 Conference
발행연도
2011.11
수록면
58 - 61 (4page)

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By exploring the specific characteristics of the matrices of Reed-Solomon (RS) based low-density parity-check (LDPC) codes, the authors manage to propose an efficient memory address generation (MAG) method for time-multiplexed (TM) RS-based LDPC code decoder architecture. This unique feature directly results in the MAG scheme which works perfectly with the TM decoders. Furthermore, along with the sum and sign accumulation unit (SSAU), a methodology for designing TM RSbased LDPC code decoder supporting high decoding throughput applications such as a 10GBASE-T system is presented. By developing and evaluating three decoder architectures with different folding factors, this approach proves to be suitable for variable design requirements. In addition, a shuffle network composed of de-multiplexers (deMUX’s) and routing blocks is also incorporated to reduce the decoding latency.
#Reed-Solomon (RS) #low-density parity-check (LDPC) codes #decoder architecture #10GBASE-T #folding factor.

목차

Abstract
I. INTRODUCTION
II. RS-BASED LDPC CODES
III. DESIGN OF MAG FOR RS-BASED LDPC DECODERS
IV. ARCHITECTURES FOR RS-BASED LDPC DECODER
V. CONCLUSION
REFERENCES

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