A Design of Multiple-Valued Logic Circuits Using Neuron Mos Transister

M. Inui; H. Imai; K. Harashima; T. Kutsuwa

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자료유형: 학술대회자료

저자정보: M. Inui H. Imai K. Harashima T. Kutsuwa

저널정보: 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2002 Proceedings

발행연도: 2002.7

수록면: 1,297 - 1,300 (4page)

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