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학술대회자료
저자정보
Myoung-Keun You (충북대학교) Young-Jin Oh (충북대학교) Gi-Yong Song (충북대학교)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2008
발행연도
2008.7
수록면
781 - 784 (4page)

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The implementation of a functional verification system using SystemC, system-level design language, is presented in this paper. SystemC is used in system-level design methodology because of the capability of system architectural model description and hardware/software design. The implemented verification system, which consists of various SystemC modules, in this paper can explore design space using SystemC and verify functional correction of progressive refined module in RTL HDL. The functional verification is performed on a simple device-under-test, the transposed FIR filter. Connections between SystemC simulation kernel and HDL simulator are achieved through user-defined system function of HDL simulator and communication channel.

목차

Abstract
1. Introduction
2. Preliminary
3. Implementation of a Functional Verification System using SystemC
4. Simulation and Result
5. Conclusions
References

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