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논문 기본 정보

자료유형
학술대회자료
저자정보
이석현 (서울대학교) 최기영 (서울대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2008년도 SOC 학술대회
발행연도
2008.5
수록면
235 - 238 (4page)

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본 논문에서는 loop pipelining과 loop unrolling을 모두 고려하는 새로운 loop transformation 방법을 제안한다. 먼저 loop carried dependency를 고려하여 성능제약조건을 만족시키는 loop pipelining 방법을 제안하고, loop unrolling에 의한 overhead를 계산하기 위해서 스케줄 된 control data flow graph로부터 register, multiplexer, control logic의 크기를 예측하였다. 이를 통해 제안한 방법으로 자동적으로 unrolling overhead를 고려하여 최적의 unroll factor를 찾고, 최대의 throughput을 가지는 해를 찾을 수 있었다. 결론적으로 설계자는 이전의 방법에 비해 체계적으로 설계공간탐색을 할 수 있게 된다.
#high level synthesis #loop pipe lining #loop unrolling #design space exploration

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. Loop carried dependency를 고려한 loop pipelining
Ⅲ. Unrolling overhead의 예측
Ⅳ. Loop unrolling을 통한 최적화
Ⅴ. 실험결과
Ⅵ. 결론
참고문헌

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