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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ICEIC : International Conference on Electronics, Informations and Communications ICEIC : 2008
- 발행연도
- 2008.6
- 수록면
- 1,096 - 1,099 (4page)
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In this paper, high-performance low-power 2-D inverse transform architecture for WMV9/VC-1 video compression is proposed. Its processing element is implemented with only adders and MUX without multipliers by exploiting the characteristics of constant matrix. Furthermore, it reduces the number of processing elements to half where each processing element processes two columns simultaneously. Its gate count is about 15,000 gates, and it can perform the 2D inverse transform of D1 image format at the clock frequency of 32㎒.
목차
Abstract
1. Introduction
2. WMV9/VC-1 Inverse Transform Algorithm
3. 2-D Architecture design
4. Performance and Gate Counts
5. Conclusion
References
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